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使用Quartus2时为什么要进行引脚锁定
1、一个是时序约束，另一个就是逻辑锁定。时序约束是按照你的时序要求去布局布线。而逻辑锁定则是指设计者将某个模块或者某个网络指定在器件的某个位置。
2、quartus II0中，cpld引脚如何锁定 5 我正在用MAXII系列的CPLD，型号是EMP7032SLC44-10N，此芯片型号只有quartusII0才支持，但是在管脚锁定(按钮PinPlanner)的时候，发现框中没有管脚锁定的命令，只有一个CLPD的管脚图。
3、为了避免以上情况的出现，常常使用Virtual Pin对非IO引脚的信号进行约束，经过约束的信号，综合布线器将不对其分配IO资源。
4、d． 这时，你所需要输出的数据就锁存在On上了，输入的数据在变化也影响不到输 出的数据了；实际上，单片机现在在忙着干别的事情，串行通信、扫描键盘……单 片机的资源有限啊。
51单片机ALE引脚释疑..理解的帮个忙!
－－解释一：ALE低电平时，P0口上的内容和锁存器输出一致。－－ 这句话，说反了。应该是：ALE低电平时，锁存器输出的就是刚才P0口上的内容。
这个引脚的功能是不能受程序控制的，如果把EA设置为低电平，51从外部rom读取指令，ale就是锁存信号。
ALE端的负载驱动能力为8个LS型TTL。此引脚的第二功能PROG是对片内带有4K EPROM的8751固化程序时，作为编程脉冲输入端。
ALE是自动运行的 ALE：地址锁存控制/片内EPROM编程脉冲输入信号 ALE(Address Lock Enable)功能是在访问外部存储器时，P0口做为地址/数据复用口，ALE信号用于锁存低8位地址。
MCS-51单片机的ALE为地址锁存信号，每个机器周期输出两个正脉冲。在一般情况下，ALE以晶振六分之一的固定频率输出脉冲，可用来作为外部定时器或时钟使用。
单片机种，ALE 是英文ADDRESS LATCH ENABLE的缩写，表示允许地址锁存允许信号。当访问外部存储器时，ALE 信号负跳变来触发外部的8 位锁存器 (如74LS373)，将端口P0 的地址总线(A0-A7)锁存进入锁存器中。
为啥AD画好的元件在原理图中管脚还能移动
很简单，引脚的具有方向性，自己绘制的原理图库，你要把具有电气连接点的一端朝外边，默认电气连接点朝右边，所以你不改的情况下，左边的引脚不会跟着拖动，而右边的可以。
一个器件有若干个子器件（part），重新编号的时候，part名称会改变，造成原理图封装变化，位置移动。
在库编辑界面引脚和芯片框是没有关联的，当然不会跟着动。在原理图界面期间才是一体的，才能一起动，甚至在原理图界面，取消了“原始锁定”也是可以自由拖动引脚的。
制作原理图元件时，引脚是可以随便放置的，没有位置对不对的说法，而且为了方便画原理图，往往是故意移动引脚位置，并不影响PCB。只要引脚编号(number)正确，转成PCB时就是正确的。
这样的话就需要你自己来画这个元件的原理图了，建立一个schlib文件，在里边创建新元件，拉一个框出来，在四周按你要的顺序和位置摆放管脚，标注好DESIGNATOR和NAME，保存好就可以了。注意管脚名称和标号一定要对应正确。
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